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cmos工艺流程谁知道？

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cmos工艺流程谁知道？

浏览：34次 | 提问时间： 07-29 05:59

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6个答案

东方不败赢了天下没了爱 07-29 06:00

什么是cmos技术以金属-氧化物-半导体（MOS）场效应晶体管为主要元件构成的集成电路。简称MOSIC。1964年研究出绝缘栅场效应晶体管。直到1968年解决了MOS器件的稳定性，MOSIC得到迅速发展。MOS具有以下优点&8226;与双极型集成电路相比，MOSIC具有以下优点：①*结构简单，隔离方便。②电路尺寸小、功耗低适于高密度集成。③MOS管为双向器件，设计灵活性高。④具有动态工作独特的能力。⑤温度特性好。其缺点是速度较低、驱动能力较弱。一般认为MOS集成电路功耗低、集成度高，宜用作数字集成电路；双极型集成电路则适用作高速数字和模拟电路。CMOS的发展与分类&8226;按晶体管的沟道导电类型，可分为P沟MOSIC、N沟MOSIC以及将P沟和N沟MOS晶体管结*一个电路单元的互补MOSIC，分别称为PMOS、NMOS和CMOS集成电路。随着工艺技术的发展，CMOS集成电路已成为集成电路的主流，工艺也日趋完善和复杂，由P阱或N阱CMOS发展到双阱CMOS工艺。80年代又出现了集双极型电路和互补金属-氧化物-半导体（CMOS）电路优点的BiCMOS集成电路结构。按栅极材料可分为铅栅、硅栅、硅化物栅和难熔金属（如钼、钨）栅等MOSICP阱CMOS工艺P阱CMOS工艺以N型单晶硅为衬底，在其上制作P阱。NMOS管做在P阱内，PMOS管做在N型衬底上。P阱工艺包括用离子注入或扩散的方法在N型衬底中掺进浓度足以中和N型衬底并使其呈P型特性的P型杂质，以保证P沟道器件的正常特性。P阱CMOS工艺P阱杂质浓度的典型值要比N型衬底中的高5~10倍才能保证器件性能。然而P阱的过度掺杂会对N沟道晶体管产生有害的影响，如提高了背栅偏置的灵敏度，增加了源极和漏极对P阱的电容等。标准P阱CMOS工艺结构特点&8226;这种结构的缺点是：（1）由于NPN晶体管的基区在P阱中，所以基区的厚度太大，使得电流增益变小；（2）集电极的串联电阻很大，影响器件性能；（3）NPN管和PMOS管共衬底，使得NPN管只能接固定电位，从而限制了NPN管的使用。

其实很想你 07-29 06:08

在计算机领域，CMOS常指保存计算机基本启动*(如日期、时间、启动设置等)的芯片。有时人们会把CMOS和BIOS混称，其实CMOS是主板上的一块可读写的RAM芯片，是用来保存BIOS的硬件配置和用户对某些参数的设定。CMOS可由主板的电池供电，即使系统掉电，*也不会丢失。

记忆是盛开满纸的荒凉 07-29 06:16

一、表面清洗晶圆表面附着一层大约2um的Al2O3和甘油混合液保护之,在制作前必须进行化学刻蚀和表面清洗。二、初次氧化有热氧化法生成SiO2缓冲层，用来减小后续中Si3N4对晶圆的应力氧化技术干法氧化Si(固)+O2àSiO2(固)湿法氧化Si(固)+2H2OàSiO2(固)+2H2干法氧化通常用来形成，栅极二氧化硅膜，要求薄，界面能级和固定电荷密度低的薄膜。干法氧化成膜速度慢于湿法。湿法氧化通常用来形成作为器件隔离用的比较厚的二氧化硅膜。当SiO2膜较薄时，膜厚与时间成正比。SiO2膜变厚时，膜厚与时间的平方根成正比。因而，要形成较厚的SiO2膜，需要较长的氧化时间。SiO2膜形成的速度取决于经扩散穿过SiO2膜到达硅表面的O2及OH基等氧化剂的数量的多少。湿法氧化时，因在于OH基在SiO2膜中的扩散系数比O2的大。氧化反应，Si表面向深层移动，距离为SiO2膜厚的0.44倍。因此，不同厚度的SiO2膜，去除后的Si表面的深度也不同。SiO2膜为透明，通过光干涉来估计膜的厚度。这种干涉色的周期约为200nm，如果预告知道是几次干涉，就能正确估计。对其他的透明薄膜，如知道其折射率，也可用公式计算出(dSiO2)/(dox)

妳比夏天還溫暖 07-29 06:25

(nox)/(nSiO2)。SiO2膜很薄时，看不到干涉色，但可利用Si的疏水性和SiO2的亲水性来判断SiO2膜是否存在。也可用干涉膜计或椭圆仪等测出。SiO2和Si界面能级密度和固定电荷密度可由MOS二极管的电容特性求得。(100)面的Si的界面能级密度最低，约为10E+10--10E+11/cm–2.eV-1数量级。(100)面时，氧化膜中固定电荷较多，固定电荷密度的大小成为左右阈值的主要因素。三、CVD(ChemicalVapordeposition)法沉积一层Si3N4(HotCVD或LPCVD)。1常压CVD(NormalPressureCVD)NPCVD为最简单的CVD法，使用于各种领域中。其一般装置是由(1)输送反应气体至反应炉的载气体精密装置；(2)使反应气体原料气化的反应气体气化室；(3)反应炉；(4)反应后的气体回收装置等所构成。其中中心部分为反应炉，炉的形式可分为四个种类，这些装置中重点为如何将反应气体均匀送入，故需在反应气体的流动与基板位置上用心改进。当为水平时，则基板倾斜；当为纵型时，着反应气体由中心*出，且使基板夹具回转。而汽缸型亦可同时收容多数基板且使夹具旋转。为扩散炉型时，在基板的上游加有混和气体使成乱流的装置。2低压CVD(LowPressureCVD)此方法是以常压CVD为基本，*改善膜厚与相对阻抗值及生产所创出的方法。主要特征：(1)由于反应室内压力减少至10-1000Pa而反应气体，载气体的平均自由行程及扩散常数变大，因此，基板上的膜厚及相对阻抗分布可大为改善。反应气体的消耗亦可减少；(2)反应室成扩散炉型，温度控制最为简便，且装置亦被简化，结果可大幅度改善其可靠性与处理能力(因低气压下，基板容易均匀加热)，因基可大量装荷而改善其生产性。3热CVD(HotCVD)/(thermalCVD)此方法生产性高，梯状敷层性佳(不管多凹凸不平，深孔中的表面亦产生反应，及气体可到达表面而附着薄膜)等，故用途极广。膜生成原理，例如由挥发性金属卤化物(MX)及金属有机化合物(MR)等在高温中气相化学反应(热分解，氢还原、氧化、替换反应等)在基板上形成氮化物、氧化物、碳化物、硅化物、硼化物、高熔点金属、金属、半导体等薄膜方法。因只在高温下反应故用途被限制，但由于其可用领域中，则可得致密高纯度物质膜，且附着强度极强，若用心控制，则可得安定薄膜即可轻易制得触须(短纤维)等，故其应用范围极广。热CVD法也可分成常压和低压。低压CVD适用于同时进行多片基片的处理，压力一般控制在0.25-2.0Torr之间。作为栅电极的多晶硅通常利用HCVD法将SiH4或Si2H。气体热分解（约650oC）淀积而成。采用选择氧化进行器件隔离时所使用的氮化硅薄膜也是用低压CVD法，利用氨和SiH4或Si2H6反应面生成的，作为层间绝缘的SiO2薄膜是用SiH4和O2在400--4500oC的温度下形成SiH4+O2–-SiO2+2H2或是用Si(OC2H5)4(TEOS:tetra–ethoxy–silanc)和O2在750oC左右的高温下反应生成的，后者即采用TEOS形成的SiO2膜具有台阶侧面部被覆性能好的优点。前者，在淀积的同时导入PH3气体，就形成磷硅玻璃（PSG：phosphor–silicate–glass）再导入B2H6气体就形成BPSG(borro–phosphor–silicate–glass)膜。这两种薄膜材料，高温下的流动性好，广泛用来作为表面平坦性好的层间绝缘膜。4电浆增强CVD(PlasmaEnhancedCVD)NPCVD法及LPCVD法等皆是被加热或高温的表面上产生化学反应而形成薄膜。PECVD是在常压CVD或LPCVD的反应空间中导入电浆(等离子体)，而使存在于空间中的气体被活化而可以在更低的温度下制成薄膜。激发活性物及由电浆中低速*与气体撞击而产生。光CVD(PhotoCVD)PECVD使薄膜低温化，且又产生如A-Si般的半导体元件。但由于薄膜制作中需考虑：(1)在除去高温(HCVD)及PECVD时掺入元件中的各种缺陷(如PECVD中带电粒子撞击而造成的损伤)；(2)不易制作的元件(不纯物剖面)，不希望在后面受到工程高温处理被破坏，因此希望可于低温中被覆薄膜。PCVD是解决这此问题的方法之一。遇热分解时，因加热使一般分子的并进运动与内部自由度被激发(激发了分解时不需要的自由度)，相对的，在PCVD中，只直接激发分解必须的内部自由度，并提供活化物促使分解反应。故可望在低温下制成几无损伤的薄膜且因光的聚焦及扫描可直接描绘细线或蚀刻。5MOCVD(MetalOrganicCVD)&分子磊晶成长(MolecularBeamEpitaxy)CVD技术另一重要的应用为MOCVD，此技术与MBE(MolecularBeamEpitaxy)同为：(1)成长极薄的结晶；(2)做多层构造；(3)多元混晶的组成控制；(4)目标为化合物半导体的量产。此有装置有下列特征：(1)只需有一处加热，装置构造简单，量产装置容易设计；(2)膜成长速度因气体流量而定，容易控制；(3)成长结晶特性可由阀的开头与流量控制而定；(4)氧化铝等绝缘物上可有磊晶成长；(5)磊晶成长可有选择，不会被刻蚀。相反地亦有：(1)残留不纯物虽已改善，但其残留程度极高；(2)更希望再进一步改良对结晶厚度的控制；(3)所用反应气体中具有引火性、发水性，且毒性强的气体极多；(4)原料价格昂贵等缺点。多层布线间的层间绝缘膜的沉积，以及最后一道工序的芯片保护膜的沉积必须在低温下(450C以下)下进行，以免损伤铝布线。等离子CVD法就是为此而发明的一种方法。6外延生长法(LPE)外延生长法(epitaxialgrowth)能生长出和单晶衬底的原子排列同样的单晶薄膜。在双极型集成电路中，为了将衬底和器件区域隔离(电绝缘)，在P型衬底上外延生长N型单晶硅层。在MOS集成电路中也广泛使用外延生长法，以便容易地控制器件的尺寸，达到器件的精细化。此时，用外延生长法外延一层杂质浓度低(约1015cm-3)的供形成的单晶层、衬底则为高浓度的基片，以降低电阻，达到基极电位稳定的目的。LPE可以在平面或非平面衬底生长、能获得十分完善的结构。LPE可以进行掺杂，形成n-和p-型层，设备为通用外延生长设备，生长温度为300oC-900oC，生长速率为0.2um-2um/min，厚度0.5um-100um，外延层的外貌决定于结晶条件，并直接获得具有绒面结构表面外延层。四、涂敷光刻胶光刻*过程中，往往需采用20-30道光刻工序，现在技术主要采有紫外线(包括远紫外线)为光源的光刻技术。光刻工序包括翻版图形掩膜*，硅基片表面光刻胶的涂敷、预烘、曝光、显影、后烘、腐蚀、以及光刻胶去除等工序。(1)光刻胶的涂敷在涂敷光刻胶之前，将洗净的基片表面涂上附着性增强剂或将基片放在惰性气体中进行热处理。这样处理是为了增加光刻胶与基片间的粘附能力，防止显影时光刻胶图形的脱落以及防止湿法腐蚀时产生侧面腐蚀(sideetching)。光刻胶的涂敷是用转速和旋转时间可自由设定的甩胶机来进行的。首先、用真空吸引法将基片吸在甩胶机的吸盘上，将具有一定粘度的光刻胶滴在基片的表面，然后以设定的转速和时间甩胶。由于离心力的作用，光刻胶在基片表面均匀地展开，多余的光刻胶被甩掉，获得一定厚度的光刻胶膜，光刻胶的膜厚是由光刻胶的粘度和甩胶的转速来控制。所谓光刻胶，是对光、*束或X线等敏感，具有在显影液中溶解性的性质，同时具有耐腐蚀性的材料。一般说来，正型胶的分辩率高，而负型胶具有高感光度以及和下层的粘接性能好等特点。光刻工艺精细图形(分辩率，清晰度)，以及与其他层的图形有多高的位置吻合精度(套刻精度)来决定，因此有良好的光刻胶，还要有好的曝光系统。(2)预烘(prebake)因为涂敷好的光刻胶中含有溶剂，所以要在80C左右的烘箱中在惰性气体环境下预烘15-30分钟，去除光刻胶中的溶剂。(3)曝光将高压水银灯的g线(l

没心没肺 07-29 06:33

436nm),i线(l

边爱人 07-29 06:41

365nm)通过掩模照射在光刻胶上，使光刻胶获得与掩模图形同样的感光图形。根据曝光时掩模的光刻胶的位置关系，可分为接触式曝光、接近式曝光和投影曝光三种。而投影曝光又可分为等倍曝光和缩小曝光。缩小曝光的分辩率最高，适宜用作*，而且对掩模无损伤，是较常用的技术。缩小曝光将掩模图形缩小为原图形的1/5-1/10，这种场合的掩模被称为掩模原版(reticle)。使用透镜的曝光装置，其投影光学系统的清晰度R和焦深D分别用下式表示：R

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